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徐彦峰

作品数：19 被引量：0H指数：0
供职机构：中国电子科技集团第五十八研究所更多>>
相关领域：自动化与计算机技术文化科学更多>>

合作作者

文献类型

  • 19篇中文专利

领域

  • 5篇自动化与计算...
  • 2篇文化科学

主题

  • 8篇FPGA
  • 6篇移位寄存器
  • 6篇用户
  • 6篇用户操作
  • 6篇桥接
  • 6篇寄存器
  • 6篇故障定位
  • 4篇可编程逻辑
  • 3篇地址发生器
  • 3篇冗余
  • 3篇冗余结构
  • 3篇数据发生器
  • 3篇嵌入式
  • 3篇嵌入式存储
  • 3篇嵌入式存储器
  • 3篇发生器
  • 3篇存储器
  • 2篇电启动
  • 2篇定制
  • 2篇定制方法

机构

  • 19篇中国电子科技...
  • 4篇无锡中微亿芯...

作者

  • 19篇徐彦峰
  • 8篇李晓磊
  • 8篇于大鑫
  • 6篇陈诚
  • 6篇季正凯
  • 5篇胡凯
  • 3篇胡恩
  • 3篇张伟
  • 3篇杨超
  • 2篇周亚丽
  • 2篇汤赛楠
  • 2篇单悦尔
  • 2篇张艳飞
  • 2篇陆峰
  • 2篇何小飞
  • 2篇徐玉婷

年份

  • 2篇2021
  • 2篇2020
  • 1篇2019
  • 2篇2018
  • 1篇2017
  • 3篇2016
  • 1篇2014
  • 3篇2013
  • 2篇2012
  • 2篇2011
共 19 条 记 录，以下是 1-10
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排序方式：
一种支持高效乘法运算的基本逻辑单元
本发明公开了一种支持高效乘法运算的基本逻辑单元，涉及可编程逻辑技术领域，该基本逻辑单元内包括查找表和两条加法进位链，通过查找表实现与逻辑产生部分积，第一加法进位链对部分积进行一次求和，第二加法进位链可以对第一加法进位链的...
范继聪徐彦峰闫华陈波寅
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一种FPGA单长线斜向开关的测试方法
本发明涉及一种基于Virtex架构的FPGA单长线斜向开关的测试方法，仅用四次配置就完成。本发明的优点是：以移位寄存器链模式测试FPGA电路的单长线斜向开关，可以测试24根为一组的单长线的任意2根信号之间的桥接故障；仅用...
于大鑫周亚丽徐彦峰陈诚季正凯李晓磊
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一种基于FPGA的ASIC快速定制方法
本发明公开了一种基于FPGA的ASIC快速定制方法，涉及ASIC技术领域，该方法基于FPGA架构对其进行层次化优化设计、内部配置RAM固化以及上电启动优化得到优化后的第一版图数据文件，依据符合用户定制需求的码流文件与第一...
王兴宏徐彦峰单悦尔闫华张艳飞
一种FPGA六长线及其斜向互连开关的测试方法
本发明公开了一种配置次数尽可能少的基于Virtex架构的FPGA六长线及其斜向互连开关的测试方法，该方法以移位寄存器链模式测试FPGA电路的六长线，可以测试6根为一组的同方向的六长线的任意2根信号之间的桥接故障；总计采用...
于大鑫徐彦峰陈诚季正凯李晓磊
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一种测试FPGA单长线及连接开关的扩展布线方法
本发明公开了一种测试FPGA单长线及连接开关的扩展布线方法，步骤包括：设置轮回行并初始化参数，快速分组，线序预估，二次过滤，线序拼接，回退判定，拆除重布，结果扩展，结果验证。其优点是：依据层次式FPGA的结构特点，提出了...
李晓磊徐彦峰于大鑫
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一种非全覆盖的八输入查找表结构
本发明涉及一种非全覆盖的八输入查找表结构，该查找表结构包括25个基本逻辑单元，含2个LUT4、4个LUT3和19个二选一MUX；10个信号端口，含8个信号输入端口A，B，C，D，E0，F0，E1，F1和2个信号输出端口Y...
苏润丰范继聪徐彦峰董宜平胡凯单悦尔
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一种嵌入式存储器的冗余结构
本发明涉及一种嵌入式存储器的冗余结构，包括：正常数据存储阵列，用于正常情况下的数据存储；冗余存储阵列，用于替换正常数据存储阵列中的故障列；MBIST控制器，用于控制存储器的自检测行为；MBIST地址发生器，用于产生自检测...
徐彦峰杨超张伟胡恩张艳飞汤赛楠
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一种FPGA单长线及其直连开关的测试方法
本发明涉及一种基于Virtex架构的FPGA单长线及其直连开关的测试方法，仅用四次配置就完成。本发明的优点是：以移位寄存器链模式测试FPGA电路的24根单长线，可以测试24根为一组的单长线的任意2根信号之间的桥接故障；仅...
陆峰徐彦峰于大鑫陈诚季正凯李晓磊
用于可编程逻辑器件配置存储器的数据中继结构
本发明涉及一种用于可编程逻辑器件的配置存储器结构中的数据中继结构，该结构包含多个分布式数据中继模块级联。每级数据中继模块包含存储器清零、数据写入和数据读取三个功能，每级数据中继模块都包含预充电读写模块和锁存模块。数据写入...
何小飞胡凯徐玉婷徐彦峰
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一种支持高效乘法运算的基本逻辑单元
本发明公开了一种支持高效乘法运算的基本逻辑单元，涉及可编程逻辑技术领域，该基本逻辑单元内包括查找表和两条加法进位链，通过查找表实现与逻辑产生部分积，第一加法进位链对部分积进行一次求和，第二加法进位链可以对第一加法进位链的...
范继聪徐彦峰闫华陈波寅
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