国家自然科学基金(60076014) 作品数:10 被引量:31 H指数:4 相关作者: 童家榕 来金梅 倪刚 郭斌林 陈苑锋 更多>> 相关机构: 复旦大学 更多>> 发文基金: 国家自然科学基金 国家教育部博士点基金 国家高技术研究发展计划 更多>> 相关领域: 电子电信 自动化与计算机技术 更多>>
适用于数据通路的可编程逻辑器件FDP100K软件系统 被引量:3 2007年 本软件系统是适用于第一款国产可编程逻辑器件FDP100K(FDP:FPGA for Data-Path)的实用软件开发系统.该软件系统中的各模块针对FDP100K硬件结构提出新的实现算法,尤其是后端的工艺映射和布局布线两个模块.经过完整软硬件协同测试表明:该软件系统各模块功能正确,与总控模块接口正确,与硬件对应接口正确,能高效正确地实现数据通路领域电路和其他类型电路的功能. 胡欣 来金梅 陈苑锋 王波 童家榕关键词:工艺映射 布局布线 可编程逻辑器件 层次式布线资源FPGA连线开关的设计 被引量:5 2005年 提出了一种层次式布线资源FPGA连线开关的设计方法,采用迷宫算法,对连线开关的结构进行了分析。针对连线连接盒CB(connectionbox),提出了较为节省芯片面积的半连通结构;针对连线开关盒SB(switchbox),在给出连通度fs概念后,提出了使SB连通能力达到最大值的设计方法,并通过数学推导予以证明。应用这种设计方法,设计了一种fs=3的SB;成功地实现了采用这种结构的SB和半连通CB作为连线开关的FPGA芯片FDP100K。该芯片在电路布通率和芯片面积方面取得了较好的平衡结果。 孙劼 童家榕关键词:FPGA 连接盒 通用的FPGA逻辑单元映射工具 被引量:4 2006年 提出了基于图模式匹配的逻辑单元映射的新颖思想,开发了针对不同结构的逻辑单元都能适用的映射工具FDUMap.实验中应用FDUMap将测试电路映射到不同的逻辑单元中,该工具比起现有的几种专用的逻辑单元映射工具,有更好的通用性. 倪刚 童家榕 来金梅关键词:工艺映射 现场可编程门阵列 针对MUX-LUT混合结构的FPGA工艺映射算法研究 被引量:3 2004年 针对具有MUX LUT混合结构的FPGA芯片 ,提出一种对其进行工艺映射的面积优化映射算法 该算法的内容包括逻辑门电路到MUX网络的转换方法 ,MUX网络到FPGA芯片逻辑单元的映射方法 文中算法采用模式匹配的方法除去电路中的冗余MUX ,以减少映射结果的面积开销 应用测试电路分别对该算法和Xilinx的Foun dation系统对XC4 0 0 3E芯片的工艺映射结果进行了比较测试 。 温宇杰 童家榕关键词:FPGA芯片 工艺映射 现场可编程门阵列 FPGA评估系统 2006年 介绍了自主开发的FPGA结构评估系统.该系统采用与结构无关的算法,对各种工业及学术上的FPGA结构进行抽象建模,并给出功耗、面积及时延的评估报告.采用该系统,能够对现有的FPGA结构进行分析,最终提出结构的改进方向. 陈苑锋 唐璞山 来金梅 童家榕基于对可编程逻辑块建模的FPGA通用装箱算法 被引量:2 2007年 装箱是FPGA工艺映射中的最后一步流程。该文提出了一种全新的对FPGA可编程逻辑块进行功能级建模的方法,并给出了基于此建模的通用性装箱算法FDUPack。实验中应用该建模方法对几种不同类型的FPGA的逻辑块进行建模,并使用装箱算法将大量的测试电路装箱到这些不同的逻辑块中,经过与已有的针对某一特定结构的装箱算法比较,该算法体现了很好的通用性。 倪刚 童家榕 来金梅关键词:工艺映射 装箱算法 现场可编程门阵列 应用于FPGA芯片的边界扫描电路 被引量:2 2004年 针对在FPGA芯片中的应用特点,设计了一种边界扫描电路,应用于自行设计的FPGA新结构之中。该电路侧重于电路板级测试功能的实现,兼顾芯片功能的测试;同时,加入了器件编程功能。在电路设计中采用单触发器链寄存器技术,节省芯片面积。版图设计采用0.6μm标准CMOS工艺,并实际嵌入FPGA芯片中进行流片。该电路可实现测试、编程功能,并符合IEEE1149.1边界扫描标准的规定,测试结果达到设计要求。 马晓骏 童家榕关键词:现场可编程门阵列 可测试性设计 一种适于数据通路应用的高性能可编程逻辑单元 被引量:2 2002年 本文提出了一种适于数据通路应用的快速可编程逻辑单元 .该单元采用功能增强的MUX结构 ,在配置为异或 同或 多路选择器 (XOR XNOR MUX)结构时 ,只用一个单元的开销就可实现一位全加器、基本乘法单元等适于数据通路应用的功能 .该单元还能实现全部 3输入逻辑和部分 4~ 7输入逻辑 ,也是一种满足通用逻辑应用的结构 .这种单元的组合逻辑部分只采用了 3个 2选 1多路选择器 (2 :1MUX)和两个功能增强的输入可反相编程的多路选择器(2 :1EMUX) ,有效地节省面积和提高了速度 .HSPICE模拟分析表明 ,在 5V、0 6 μm工艺条件下 ,该单元的最大时延小于0 6ns,进位时延小于 0 1ns.其性能。 郭斌林 童家榕关键词:数据通路 逻辑电路 一种基于图模式匹配的逻辑单元映射算法 被引量:6 2006年 基于数学中图模式匹配的概念,根据电路特征在子图同构算法中加入图约束条件,研究了针对不同结构的FPGA逻辑单元都能适用的映射算法FDUMap·实验中应用FDUMap将测试电路映射到不同的逻辑单元中·该算法比现有的专用的逻辑单元映射算法通用性更好,而平均性能上仅相差3%· 倪刚 来金梅 童家榕关键词:工艺映射 现场可编程门阵列 一种基于扩展查询表的可编程逻辑单元 被引量:7 2003年 通过把 3输入查询表 ,展开为 7输入扩展查询表 ,提出了一种基于扩展查询表的可编程逻辑单元新结构 .通过对扩展查询表进行功能扩展和优化 ,并加入专用快速进位链、专用级联链等功能 ,使得该结构不仅可实现任意3输入 ,部分 4~ 7输入函数 ,而且也能实现快速的算术及高扇入的逻辑 .整个单元组合部分的元件开销小于一个 4输入的查询表 .与相关商用FPGA单元结构进行的比较表明 ,该文提出的单元结构不仅占用的芯片面积较小 ,而且在速度和逻辑实现的能力上都有较大的优势 . 郭斌林 童家榕关键词:FPGA 可编程逻辑器件