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教育部“新世纪优秀人才支持计划”(NCET-11-0975)

作品数：6 被引量：6H指数：2
相关作者：谢亮金湘亮王龙生段杰斌刘杨更多>>
相关机构：湘潭大学更多>>
发文基金：教育部“新世纪优秀人才支持计划”湖南省自然科学基金国家科技重大专项更多>>
相关领域：电子电信更多>>

文献类型

  • 6篇中文期刊文章

领域

  • 6篇电子电信

主题

  • 2篇高精确度
  • 1篇低功耗
  • 1篇低频
  • 1篇低通
  • 1篇低通滤波器
  • 1篇电荷泵
  • 1篇电荷泵设计
  • 1篇电力
  • 1篇电力线
  • 1篇电力线载波
  • 1篇电力线载波通...
  • 1篇电路
  • 1篇电容滤波
  • 1篇电容滤波器
  • 1篇氧化物半导体
  • 1篇载波
  • 1篇载波通信
  • 1篇增强型
  • 1篇时钟
  • 1篇时钟树

机构

  • 6篇湘潭大学

作者

  • 6篇金湘亮
  • 6篇谢亮
  • 2篇王龙生
  • 2篇段杰斌
  • 1篇张文杰
  • 1篇聂拓
  • 1篇罗志国
  • 1篇陈亮
  • 1篇陈昊
  • 1篇刘杨
  • 1篇杨凤
  • 1篇胡鹏飞

传媒

  • 3篇太赫兹科学与...
  • 2篇固体电子学研...
  • 1篇微电子学

年份

  • 1篇2016
  • 2篇2015
  • 1篇2014
  • 2篇2013
共 6 条 记 录，以下是 1-6
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排序方式：
一种数模混合芯片中数字电路的时序收敛方案被引量：2
2013年
在数模混合集成电路中,时钟信号是数据传输的基准,它对芯片能否正常工作起决定性的作用。由于数模混合集成电路的特殊性,在对时钟信号进行时钟树综合时,要对其进行特殊的处理。以串行外设接口及电平移位模块为例,提出了一种针对数模混合芯片中数字电路的时序收敛方案,验证结果表明此方案能够使时序很好地收敛。
刘杨谢亮聂拓王龙生金湘亮
关键词：数模混合集成电路时钟树综合串行外设接口
一种高精确度低功耗Delta–Sigma调制器被引量：2
2014年
提出了一种应用于工业过程控制、便携式测量仪器等领域的高精确度低功耗Delta–Sigma调制器。该调制器采用积分器级联反馈(CIFB)二阶单环一位结构实现,并利用斩波稳零技术,有效地减小了调制器的1/f噪声和直流失调。调制器采用旺宏0.35μm CMOS工艺实现。仿真结果表明,在30 Hz的信号带宽内,调制器的信噪失真比(SNDR)可以达到105 dB,在3.3 V的工作电压下,功耗仅1.3 mW,满足对低频微弱信号的检测要求。
罗志国谢亮王龙生段杰斌金湘亮
关键词：低频高精确度低功耗
带宽可调高阶开关电容滤波器的设计
2015年
对高阶开关电容滤波器的设计原理进行了研究,采用级联法进行滤波器的设计,并提出一种带宽可调的方法。借助Filter Solutions软件,设计了带宽可调的6阶开关电容椭圆低通滤波器,并结合Cadence中的Spectre RF进行仿真验证。仿真结果显示,滤波器各项指标满足设计要求,并且带宽可调方法正确有效。
胡鹏飞谢亮金湘亮
关键词：开关电容滤波器椭圆低通滤波器
一种适用于MEMS麦克风的新型恒压电荷泵设计被引量：1
2013年
实现了一种新型恒压输出电荷泵电路,通过选择合理的电荷泵结构能有效抑制反向电流及衬底电流,并通过一种负反馈稳压电路得到低纹波且不随电源电压变化的稳压输出,非常适用于MEMS麦克风。该电路采用MIXIC0.35μm标准CMOS工艺实现,测试结果表明该电路能自适应2.8～3.6V的电源电压变化,输出稳定的9V直流电压。
张文杰杨凤段杰斌谢亮金湘亮
关键词：电荷泵衬底电流
一种应用于电力线载波通信的线驱动器设计
2015年
设计了一种应用于电力线窄带载波通信发送端中的高线性度、全差分的线驱动器。该结构上包括增益可调的预放大级和功率输出级。其中预放大级的输出摆幅可调,功率输出级的静态功耗可调,可针对系统输出功耗检测电路检测到的功耗输出信息选择相应的静态功耗。电路基于中芯国际(SMIC)的0.18μm互补金属氧化物半导体(CMOS)工艺设计。后仿真结果表明,在输出摆幅峰峰值为4 V的情况下,最大电流驱动能力可达667 m A,总谐波失真(THD)小于-60 d B,符合电力线窄带载波通信的应用要求。
陈昊谢亮金湘亮
关键词：电力线载波通信总谐波失真线性度
应用于高速高精确度流水线ADC参考电压缓冲器被引量：1
2016年
通过分析流水线数字转换器(ADC)中参考电压缓冲器的工作过程,提出了相应的负载模型,并推导出缓冲器的指标,设计了一种能用于高速高精确度流水线ADC的参考电压缓冲器。该缓冲器采用了改进的开环结构,降低了设计复杂度、功耗和面积,同时采用增强型源跟随结构,提高了缓冲器驱动能力和稳定性。该参考电压缓冲器采用华力55 nm CMOS工艺进行电路和版图设计,版图面积为320μm×260μm。Spectre后仿真结果表明,参考电压缓冲器功耗为3 m A,建立时间为4.3 ns,成功应用于60 MS/s 12 bit流水线ADC。
陈亮谢亮金湘亮
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